Pg电子游戏：假信号抑制器电路与方法
本发明涉及对“假信号”的抑制，假信号即那些在控制信号中由于接触弹跳，各种类型的干扰和/或噪声所引起的不希望发生的各种变化。
低压控制信号由于各种各样的原因加于半导体器件，在这样的控制信号中不希望有的变化常会对电路的运行造成严重的有害作用。已经得知抑制这些瞬变可如下进行要求控制信号中的任何改变在它被识别为是所需的控制信号而不是不需要的瞬态之前的一个预定的有限时间周期中出现。举例说，U.S.专利No.4,505,635的说明书中公开了应用两个双稳态器件作为瞬态抑制电路，该两个双稳态器件用于在两个不同的时间对控制信号进行采样，并且两个双稳态器件的并行被要求作为控制信号向电路的传播。这种方法中，控制信号的二值状态必须在两个采样过程中保持不变以便该信号被识别为控制信号，而该假信号抑制电路的作用犹如一个滤波器，对小于两个采样持续时间的瞬态加以滤除。
然而，有时需要对假信号抑制电路加以旁路而使得控制信号直接传送到电路中。于是，本发明的一个目的是提供一种新的电路和方法用于有选择地将假信号抑制电路旁路。
另一目的是提供一种新型的选择性旁路的假信号抑制电路，该电路可集成到用于操作电路的控制线路中。
而又一目的是提供一种新型电路和方法，该电路和方法可结合到半导体器件设计之中而不必再顾及在集成电路应用中是否需要假信号抑制电路。
还有一目的是提供一种新型集成电路和方法，该电路和方法使得在每一输入线路中包含有假信号抑制电路，从而避免了由于操作电路上的温度和加工参数所引起的附加约束。
按照本发明，假信号抑制电路包括多个双稳态器件，该电路在两个或多个时钟周期中接收二值控制信号，并且除非控制信号保持相同的状态达两个或更多以时钟周期，该电路是不会改变二进制输出信号的状态的，选择性的旁路包含连接到双稳器件的装置，用于选择地通过假信号抑制电路在单独一个时钟周期中传播上述控制信号。
图1表示先有的技术的假信号抑制电路，该电路通常包括两个双稳器件或触发电路，该电路在两个不同的时钟区间对控制信号状态采样并存储。当控制信号状态在必需的时间区间中保持不变时，逻辑电路向操作电路提供输出信号。
图2表示本发明的假信号抑制电路，它包括一个输入端10接收控制信号，并与第一双稳器件12的输入端连接，该双稳器件通过使用来自输入端14的时钟信号在时间T1被采样。
当在时间T2被时钟信号触发时，双稳器件12提供一个输出信号，该信号反映了控制信号在时间T1的状态。这信号被加到第二双稳器件16的一个输入端。在时间T3，该时钟信号使得将时间T2的控制信号的输出状态反映为双稳器件12的输出信号而从双稳器件16输出的信号反映的是在时间T1的控制信号状态。
在先有技术的电路中，响应来自两个触发器的输出信号的逻辑电路提供假信号抑制器电路的输出信号。这样，只有当控制信号的状态在两个相继的时钟周期中保持不变时，该假信号抑制器电路才提供一个输出信号。
图2表示来自双稳器件12与16的输出信号被加到异(“XOR”)门18的两个输入端，该异门向第三触发器20的输入端CL“清除”提供一个信号。
该第三触发器20的连接所实现的功能是作为多路复用器用于(a)来自双稳器件16的负输出信号，以及(b)用于(通过反向器26)来自触发器的负Q一端的输出信号，以及把该多路复用信号作为向触发器20的D端的输入信号处理。
来自或门22的输出信号加到CL输入端，以及来自或门24的输出信号加到触发器20的4“预置”输入端PR。注意图2中为了绘图的方便端子CL与PR已被调换。从正Q输出端输出的输出信号通过反相器28作为该假信号抑制器电路的输出信号而被使用。
这样，本发明的假信号抑制器电路仅在控制信号的状态已在相继的两个时钟周期中保持不变时才提供一个输出信号。
因为存在不需要假信号抑制器的控制线路，并因为存在不需要假信号抑制器用于控制线路的时间，所以本发明的电路提供了选择旁路。
图2表示了复位信号可选择地通过输入端19的通路的被施加于或门22与24的两输入端之一。控制信号被加到两个或门22与24的另外的输入端，在或门22的情形则是经由反相器26加的。这样，或门22响应二值低位控制信号或二值高位复位信号而输出一个输出信号，并且或门24响应二值高位控制信号或二值高位复位信号而提供一个输出信号。其结果是，提供来自两或门22与24之一的输出信号用于控制信号的每一转换以及向输出端19施加复位信号的结果而被提供的。
来自或门22与24的输出信号加于双稳器件12与16及触发器20两者的互补复位端(即CL与PR)，使得所有这三者都被复位。
于是该假信号抑制器电路在复位信号出现于输入端19时则对控制信号成为透明的，并且由于控制信号在相继的时钟周期中已被采样，于是不需要控制信号类同地在两个时钟周期中保持控制信号的状态，也可通过其传播。
双稳器件的数目可以增加以使得任何给定的时钟信号扩大为一种时间周期，在此周期中控制信号状态必须保持不变以便被识别确为控制信号。
此处所说的双稳器件和门可以是任何可执行所指功能的适用的通常的电路。而且，其他的功能等价的电路也可以应用。但即使是应用相同的电路元件，连接方式也可以有变化，通过增加或减少反相器以平衡正负铃输出信号的使用等等。
在集成电路的设计与制造中，实际上迄今由于这些IC所需要的灵活性并未将假信号抑制器电路纳入控制电路中，这即要决定在控制电路上究竟是否需要那种抑制器，又如果需要，则何时需要那种抑制器。图3中所示，本发明使得可将本发明假信号抑制器电路30集成到集成电路34的每一控制线中去而无须作那样的考虑，因为知道决定是否要以及何时要包含这种电路在以后仅要简单地选择复位信号的施加即可解决。通过设计假信号抑制器电路集成到IC34的每一控制线中去，则假信号抑制器电路的造价可大大减少。
如图3所示，每一假信号抑制器电路都配有三条输入线，分别用于控制信号，时钟与复位信号。当然，时钟信号可由IC34的一个或多个内部源提供，于是，可免除第三个外部连线。
当本发明的假信号抑制器电路设计在IC内时，它可用作滤波器，以减少电路的噪声敏感度，对开关接触去抖动的作用而使它可直接接于IC，并抑制由于时钟与控制信号之间的同步锁定在控制信号转移过程中的采样效应。
而且，假信号抑制电路集成到IC之中使之在制造过程中经受相同的加工参数并在操作中使之经受相同的温度条件。于是假信号抑制电路并未强加于IC什么限制。
集成到半导体芯片的每一输入控制线路和可复位假信号抑制电路对每一控制线路提供了灵活性，使得是否需要假信号抑制电路以及如果需要则在何时需要都是可操作的。
1.一种包含多个双稳器件的假信号抑制电路，该电路在两个或更多的时钟周期中接收二值控制信号，并且如果该控制信号不在两个或更多的时钟周期中保持相同的状态则该电路不会改变二值输出信号状态，选择性的旁路包括与双稳器件工作连接的器件，用于在一单独时钟周期中通过假信号抑制电路传播上述控制信号。
2.权利要求1中所称的一种假信号抑制电路，其中上述用于选择传播控制信号的上述装置包含选择地在一单独时钟周期中将上述装置包含选择地在一单独时钟周期中将上述双稳器件每一个复位的装置。
3.权利要求1或2中所称的一种假信号抑制电路，其中上述假信号抑制电路包含三个或更多的可复位双稳器件。
4.权利要求1中所称的假信号抑制电路，它包括一个第一双稳器件用于接收控制信号并用于在时间T2提供与其状态相关的第一输出信号；一个第二双稳器件用于接收上述第一输出信号并用于提供与上述第一输出信号在时间T1状态相关的第二输出信号；第三双稳器件装置用于向上述第一、第二与第三双稳器件施加相继的时钟周期；用于提供第三输出信号的装置，该第三输出信号用在上述第一与第二输出信号的状态在时间T1与T2之间发生改变时施加于上述第三双稳器件；以及可操作的独立于上述控制信号状态的复位装置，用于将上述第一、第二与第三双稳器件设置为预定状态以便在每一时钟周期之中被采样时的控制信号的状态可通过该装置传播。
5.权利要求4中所称的一种假信号抑制电路，它包括施加于多个逻辑相连在一起的级连双稳器件的第一个器件的控制信号以便只有在控制信号状态在数目等于该级连双稳器件数的时钟周期数中保持不变时才提供一个输出信号；该电路功能的选择性旁路方法，该方法包括选择性地将每一双稳器件在每一时钟周期之中复位的步骤，由此，来自最后一个双稳器件的输出信号在相继的时钟周期中表示着在该相继的时钟周期中控制信号的状态。
6.一种集成电路，它包括一个或多个操作电路，每一操作电路具有一个或多个控制信号线路；上述每一控制线路中都设有一假信号抑制电路；这些假信号抑制电路的每一个都包含旁路器和旁路控制线用于响应施加到其上控制线的信号而选择地旁路假信号抑制功能。
一种可复位假信号抑制电路，该电路集成到半导体芯片的每一输入控制线路之中，以便使得每一控制线路具有灵活性；对于是否接入以及如果接入则在何时接入假信号抑制电路均是可操作的。
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